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Le lezioni di esercitazione sono riportate in colore rosso, le lezioni di laboratorio in verde le lezioni frontali in nero.
Le slide sono da considerare bozze avanzate fino al giorno della lezione. Le slide in versione definitiva, saranno disponibili sul sito il giorno dopo la lezione.
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La CPU |
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| L_01 | 27.02.2023 | Introduzione. (Prof. Borghese, ultima modifica 02.03.23). |
| 01.03.2023 | Lezione sospesa per seminario | |
| L_02 | 06.03.2023 | Introduzione alla pipeline e principi di funzionamento. La struttura della CPU MIPS con pipeline e il ruolo dei registri. Unità di controllo (Prof. Borghese, ultima modifica 06.03.23). |
| L_03 | 08.03.2023 | Soluzione degli hazard sui dati mediante feedforwarding. Sintesi del controllore di feed-forwarding. (Prof. Borghese, ultima modifica 08.03.23). |
| L_04 | 13.03.2023 | Soluzione degli Hazard sui dati mediante stallo. Stall on load. Esempi di esecuzione. Hazard sul controllo (Prof. Borghese, ultima modifica 13.03.23). |
| L_05 | 15.03.2023 |
Hazard sul controllo e loro soluzione. Delayed branch. Branch prediction buffer (Prof. Borghese, ultima modifica 15.03.23). |
| L_06 |
20.03.2023 |
Interrupt ed eccezioni. La gestione HW delle eccezioni. (Prof. Borghese, ultima modifica 20.03.2023). |
| L_07 | 22.03.2023 | Trend di sviluppo delle architetture. Parallelismo a livello di istruzione. Parallelizzazione statica e dinamica. Architetture SIMD e le istruzioni MMX, SSE e AVX. (Prof. Borghese, ultima modifica 23.03.23). |
| C_01 | 27.03.2023 | Prima prova in itinere (Versione A. Versione B). Aula Magna Alberto Bertoni. Inizio ore 9.00. Risultati. |
| Le memorie | ||
| 29.03.2023 | Sopsensione della lezione per preparazione compitino matematica | |
| L_08 | 03.04.2023 | La gerarchia delle memorie. Le cache a mappatura diretta (Prof. Borghese, ultima modifica 04.04.23). |
| 05.04.2003 | Sospensione della lezione per motivi di salute | |
| 10.04.2023 | Vacanze Pasquali | |
| 12.04.2023 | Vacanze Pasquali | |
| L_09 | 17.04.2023 | Porta lettura di una cache, memorie assoiciative e set-associative (Prof. Borghese, ultima modifica 18.04.23). |
| 19.04.2023 | Lezione sospesa per missione del docente. |
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| 24.04.2023 | Ponte del 25 Aprile |
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| L_10 | 26.04.2023 | Gestione miss. SRAM e struttura. DRAM. (Prof. Borghese, ultima modifica 26.04.23). |
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Architetture avanzate |
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| L_11 | 03.05.2023 | Tecnica di "blocking". Codici di errore. Dispositivi di memoria (Prof. Borghese, ultima modifica 08.05.23). |
| L_12 | 08.05.2023 |
I multi-core. Coerenza e consistenza della memoria. (Prof. Borghese, ultima modifica, 08.05.23). |
| L_13 | 10.05.2023 |
La virtualizzazione e la JVM. La memoria virtuale. La compilazione. (Prof. Borghese, ultima modifica 18.05.23). |
| L_14 | 15.05.2023 |
L'architettura INTEL. La pipeline dell'Intel Core i7 e dell'ARM Cortex A-53. L'architettura CISC degli INTEL. I registri. Modalità di indirizzamento. Elementi dell'ISA e della sua codifica (Prof. Borghese, ultima modifica 18.05.23). |
| 17.05.2023 |
Bus e I/O. Arbitraggio. Gestione dell'input/output. (Prof. Borghese, ultima modifica (18.05.23). |
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| L_16 | 22.05.2023 | Valutazione delle prestazioni ed esercizi. (Prof. Borghese, ultima modifica (23.05.23). |
| 29.05.2023 | Esercitazione di riepilogo. | |
| C_02 | 07.06.2023 | Esercizi. Seconda prova in itinere. Aula Magna Bertoni. Inizio ore 9.00. Risultati. |